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楼主: yyp20034

[制作] 做一个USB接口的万用表模块

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 楼主| 发表于 2020-2-13 17:36:16 | 显示全部楼层
对OP放大器的影响
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 楼主| 发表于 2020-2-13 17:37:41 | 显示全部楼层
任何噪声源,如果其产生的噪声不超过总噪声的1/3至1/5,那么就可以忽略,这就要求测量出电路同一点处的所有电压噪声。为分析运放的噪声特性,应估计电路各部分的噪声贡献,并确定那部分最大 。先解决主要矛盾!!!
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 楼主| 发表于 2020-2-13 17:38:16 | 显示全部楼层
我们来看看HP34401的放大电路,是的,你没有看错,它也使用了OP27作为放大芯片,只是由于前端输入阻抗太大,因此在采用了JFET作为输入端。
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 楼主| 发表于 2020-2-13 17:38:58 | 显示全部楼层

这种放大电路其实并不新鲜,在《晶体管电路设计 下》中已经有详细的论述
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 楼主| 发表于 2020-2-13 17:39:32 | 显示全部楼层

你GET到了吗?
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发表于 2020-2-21 19:45:18 | 显示全部楼层
坐等成品
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 楼主| 发表于 2020-2-22 20:26:52 | 显示全部楼层
可以关注一下我的微信公众号:高精度万用表的设计和应用
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 楼主| 发表于 2020-2-23 11:02:23 | 显示全部楼层
为什么要深入的了解∑-ΔADC的原理呢?是因为目前市场上在售的高分辨(>20bit)的ADC都是∑-Δ型ADC。因此深入了解∑-ΔADC的原理,来决策在万用表电路上使用哪种类型的ADC是非常有必要的。
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 楼主| 发表于 2020-2-23 11:03:33 | 显示全部楼层
图1是∑-ΔADC的原理框图,模拟输入信号[1]被添加到比较器的1位DAC输出反馈( +Vref或-Vref电压),结果[2]进入积分器。积分器累计模拟输入信号[1]和1位DAC输出反馈( +Vref或-Vref电压)之间的差值。然后,使用比较器,对积分器输出[3]与零电压参考进行比较。按照时钟频率,使用D锁存器定期锁存比较器输出[4],从而以量化的时步(时钟节拍)将比较器结果传导至调制器输出。 D锁存器输出[5]即为∑-Δ调制器的数字1位输出。输出被馈送至1位D/A转换器,后者仅输出2个可能的模拟电压(通常用作+Vref和-Vref参考电压之间的开关)。 1位输出数据流的数据速率由调制器时钟频率定义。∑-Δ调制的输出是由调制器时钟定时的数字数据流( 图 2上的黑色曲线)。该输出的平均值(在数字域中计算)表示输入模拟电压。该数字平均值应被计算为:在∑-Δ输出流内,在给定数量的时钟周期期间中观察到的1的数量与0的数量之间的比率。
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 楼主| 发表于 2020-2-23 11:04:09 | 显示全部楼层
必须对来自∑-Δ调制的输出信号进行滤波,去除高频内容(量化噪声),仅保留有用的频带。需要了解∑-Δ调制信号频谱才能正确设计此类滤波器。在∑-Δ调制频谱中,在较低频率下,能量较低,因此滤波器的设计更简单。滤波能力必须适应∑-Δ调制器的阶数。例如,数字麦克风通常具有四阶∑-Δ调制器,其在有用频带中具有低量化噪声,但在频带外具有非常强的量化噪声。必须选择滤波器阶数,以便在不影响有用频带的情况下,抑制强频带外量化噪声。∑-Δ调制将量化噪声更均匀地传导至更高频率,这一效果被称为“噪声整形”。此特性可用于设计更简单的滤波器,形成较少噪声的基带信号。
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